个人简历
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2007年毕业于金沙威尼斯欢乐娱人城，获工学博士学位； 07至08年供职于美国OmniVision公司； 08年至今就职于金沙威尼斯欢乐娱人城电子学院。12至13年美国斯坦福大学任访问学者。近年主要开展集成电路设计、信道编码、闪存纠错、机器智能等方面的研究。目前主持承担国家自然科学基金、教育部基金、江苏省重点项目、企业及科研院所横向委托等多项科研项目。已发表学术论文50余篇，引用700余次。
研究方向
集成电路设计；信道编码；闪存纠错；机器学习；异构计算
主持科研项目：
国家自然科学基金面上项目，100Gbps吞吐率高速高性能LDPC码解码器设计研究，2014-2018
江苏省产业前瞻与共性关键技术项目,面向闪存的新型纠错编码方式研发，2017-2020
国家自然科学基金青年基金项目，非二进制LDPC码解码器设计关键技术研究，2011-2013
江苏省产学研合作项目、多核处理器芯片设计、2015-2017
博士点基金项目、低复杂度非二进制LDPC解码器设计博士点基金、2011-2013
企业横向课题、中兴微电子、闪存纠错及实现、2017-2018
企业横向课题、中电集团14所、XX设备信号侦收与分析FPGA IP设计、2014-2015
企业横向课题、中电集团14所、复杂信号处理算法IP设计、2014-2016
企业横向课题、中电集团14所、复杂信号处理算法IP的高层次语言设计、2016-2017
企业横向课题、中电集团14所、复杂信号处理算法FPGA设计、2016-2017
专利转让、无锡中微爱芯电子有限公司、高速的减少存储需求的低密度校验码解码器
江苏省六大人才高峰项目、固态硬盘控制芯片设计
企业横向课题、高效率微型逆变器研发
学术兼职情况：
IEEE高级会员，IEEE ACCESS副主编，IEEE电路与系统分会VSA技术专家组成员，香港研究资助局项目评审人，IEEE Trans. on VLSI Systems、IEEE Trans. on Circuits and Systems I、IEEE Trans. on Circuits and Systems II、IEEE Trans. on Signal Processing、IET Communications等国际知名杂志的审稿专家；IEEE电路与系统年会（ISCAS）、IEEE信号处理年会（SiPS）等会议的技术委员会成员；担任ICASSP、ICCNT等众多国际会议的审稿专家；担任电子与信息学报、中国图像图形学报、浙大学报等国内杂志审稿专家。
主要课程
本科生：数字系统；信息电子学前沿实验
研究生：SOC设计方法；数字信号处理的VLSI实现
代表成果
Xiangyun Deng, Jin Sha, etc, Joint Detection and Decoding of Polar-Coded OFDM-IDMA Systems, IEEE Transactions on Circuits and Systems I, 2019.
Xiaozhen Liu, Jin Sha, etc,Efficient Channel Estimator with Angle-Division Multiple Access, IEEE Transactions on Circuits and Systems I, 2019. Guanghui Hu, Jin Sha, etc. High-Speed Parallel LFSR Architectures Based on Improved State-Space Transformations，IEEE Transactions on Very Large Scale Integration Systems，2017. Jin Sha, Jingbo Liu and Zhongfeng Wang, Improved BP decoder for polar codes based on a modified kernel matrix, Electronics Letters, 2016. Kai He, Jin Sha, etc. “Nonbinary LDPC Code Decoder Architecture With Efficient Check Node Processing”, IEEE Trans. on Circuits and Systems II, vol. 59, no. 6, pp. 381-385, 2012. Jin Sha, etc. “Multi-Gb/s LDPC Code Design and Implementation”，IEEE Trans. on VLSI Systems, vol. 17, no. 2, pp. 262-268, Feb. 2009. Jin Sha, etc. “Decoder Design for RS-Based LDPC Codes”, IEEE Trans. on Circuits and Systems II, vol. 56, no. 9, pp. 724-728, Sep. 2009.
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